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PLFM_RADAR:一台可以亲手搭的10.5GHz开源相控阵雷达

PLFM_RADAR:一台可以亲手搭的10.5GHz开源相控阵雷达 PLFM_RADAR一台可以亲手搭的10.5GHz开源相控阵雷达【免费下载链接】PLFM_RADAROpen-source, low-cost 10.5 GHz PLFM phased array RADAR system项目地址: https://gitcode.com/GitHub_Trending/pl/PLFM_RADAR提到相控阵雷达多数人想到的是报价百万的商用黑盒连内部图纸都拿不到。而 PLFM_RADAR 反着来它把一台 10.5GHz 脉冲线性调频PLFM即每段发射脉冲内频率随时间线性变化相控阵雷达的全部材料开源了——原理图、FPGA 信号处理代码、STM32 固件和 Python 界面一个不少。你可以先在电脑上跑演示也可以照着生产文件把真机焊出来。这台开源相控阵雷达是给谁准备的仓库里的正式型号叫 AERIS-10定位一句话面向科研人员、无人机开发者和高级 SDR软件无线电爱好者的开源低成本 10.5GHz 相控阵雷达平台。它不是一次性图纸堆而是从射频前端到桌面对话框的完整交付。硬件、固件、GUI 全链路开源3km / 20km 两个量级版本可选FPGA 板载完成脉冲压缩与目标检测±45° 电扫 360° 机械旋转全覆盖它替你省掉了什么省掉黑盒成本。商用雷达最值钱的部分是算法链路这里全部摊开脉冲压缩、多普勒、MTI动目标显示滤掉静止杂波、CFAR恒虚警率检测自适应判断哪里是目标每个环节都是可读可改的 Verilog 模块还配了测试平台。省掉硬件试错成本。生产文件目录 里按板卡分好 Gerber、BOM 物料清单和 CPL 贴片坐标外加堆叠说明 Stack_Hybrid.png 这类工艺文档从打样到贴片的材料链是齐的。省掉学习路径成本。系统拆成 FPGA 算数、STM32F746 管时序与外设、Python 做展示三层每层都能独立上手不必一上来就啃完整座山。版本速览AERIS-10N 与 AERIS-10E 对比功能维度AERIS-10NNexusAERIS-10EExtended最大探测距离约 3 km约 20 km天线阵列8×16 贴片阵32×16 介质填充开槽波导阵发射功率约 1W × 16 路10W GaN氮化镓功放 × 16 路波束扫描±45° 电扫 360° 步进电机同左信号处理XC7A50T FPGA STM32F746同左![AERIS-10相控阵雷达系统功能框图](https://raw.gitcode.com/GitHub_Trending/pl/PLFM_RADAR/raw/749bd0f86a07a28a86347d8ce9c141e601057c40/2_Functional Diagram Interconnection Matrices/RADAR_V6_V2.png?utm_sourcegitcode_repo_files)图AERIS-10 系统功能框图覆盖信号生成、射频收发到数字处理的全链路互联上手起步从演示界面到真机硬件无需硬件三步装好 GUI 并看到目标列表git clone https://gitcode.com/GitHub_Trending/pl/PLFM_RADAR cd PLFM_RADAR/9_Firmware/9_3_GUI pip install -r requirements_v7.txt python GUI_V7_PyQt.py跑完你会看到雷达主界面点击演示模式后距离-多普勒图实时刷新右侧表格同步给出每个目标的距离、速度和方位还能落到地图上。图GUI 主界面展示距离-多普勒图、目标列表与地图定位运行阵列仿真脚本画出 32×16 阵的方向图cd PLFM_RADAR/5_Simulations python array_pattern_Kaiser25dB_like.py跑完你会得到 E 面、H 面切面曲线和一张方向图热力图标题栏直接标出 -3dB 波束宽度波束长什么样一眼可见。图32×16 阵列在俯仰/方位二维空间中的增益分布热力图Kaiser 窗加权执行 FPGA 回归脚本在电脑上跑通信号链先装好iverilog然后cd PLFM_RADAR/9_Firmware/9_2_FPGA ./run_regression.sh --quick跑完你会看到各 Verilog 模块被逐个编译、对应的 testbench 依次执行最后打印通过/失败清单——整条信号处理链就在你本机里跑了一遍。FPGA 源码目录 下还有tb/cosim/real_data/存放的真实 ADC 数据可做回放验证。打样方向定位生产包与机械图纸无需命令按目录走即可4_7_Production Files 取 Gerber/BOM/CPL机械图纸 里有外壳、散热器和滑环图纸docs/ 里的 bring-up 指南负责调试阶段的顺序检查。深挖一条回波如何被算成距离速度造波形DAC 按 FPGA 给的参数生成 LFM chirp线性调频脉冲频率在脉冲内从低扫到高。搬上射频LTC5552 混频器把基带信号上变频到 10.5GHz16 路经 ADTR1107前端芯片接收时当低噪放、发射时当功放送天线ADAR1000 移相器给每路调相波束就指向了目标方向。搬回中频回波经同一颗混频器下变频ADC 采样进 FPGA。降速整理I/Q 基带下变频后做 CIC/FIR 抽取滤波把 400MHz 量级的原始流压到算法能吃的速率。脉冲压缩frequency_matched_filter.v做匹配滤波把被距离拉开的回波重新聚成一个尖峰等效拉高信噪比——好比先松开的弹簧猛地压到底再释放。多普勒 FFT对同一个距离门连续多个脉冲做 FFT相位变化量直接换算成速度。MTI 抑制mti_canceller.v消掉地面等不动目标留下的强回波。CFAR 判决cfar_ca.v按当前噪声水平自适应设门限剩下的亮点就是目标连同距离、速度、方位一起经 USB 送到 GUI。适合谁用第一步做什么学生与爱好者先跑通 GUI 演示再运行 array_pattern_Kaiser25dB_like.py半天就能把波束怎么成形讲清楚。FPGA / 嵌入式工程师第一步打开 radar_system_top.v 并执行回归脚本它是整个系统的位宽与协议基准。射频 / 硬件工程师第一步核对 生产文件 中 Gerber 与 BOM 的一致性为打样做准备。科研人员第一步把 cosim/real_data 的真实 ADC 数据喂进测试平台用可复现的数据集验证新算法。下一步先把演示跑起来打开终端执行cd 9_Firmware/9_3_GUI python GUI_V7_PyQt.py看着距离-多普勒图上的亮点被逐个标进目标表格——从这一刻起这台 10.5GHz 的相控阵雷达就不再是仓库里的一堆文件而是你手里能看的、能改的、能复现的系统。【免费下载链接】PLFM_RADAROpen-source, low-cost 10.5 GHz PLFM phased array RADAR system项目地址: https://gitcode.com/GitHub_Trending/pl/PLFM_RADAR创作声明:本文部分内容由AI辅助生成(AIGC),仅供参考
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